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GridLAB-D安装教程
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单相整流器和逆变器仿真
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800多套单片机毕业设计
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OpenDSSG
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Java中的Packet Sniffer项目

此项目是Java中的Packet Sniffer项目。Packet Sniffer项目是一个可用于跟踪数据包的网络实用软件。用Java开发的适用于学生的最新网络项目。该软件可以跟踪网络数据包，就像嗅探器，嗅探狗一样。下载完整的Java源代码。

2020-04-11

81
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大小: 57KB

开发平台: windows

java

JSP在线作业门户项目

此项目是JSP在线作业门户项目。在建议的系统中，我们建议将安置活动计算机化。 在现有系统中，所有数据处理都是手动完成的。 当存在许多问题时，例如信息的检索和存储以及对其进行跟踪成为一项繁琐的任务。 通过实施计算机系统，将减少本系统的局限性。 可以大大减少人力，并可以提高效率和准确性。 通过实施所提出的系统，可以将更多的时间消耗减少到更大的范围。

2020-04-11

68
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大小: 1935KB

开发平台: windows

java

JSP中的在线考勤管理系统

此项目是JSP中的在线考勤管理系统。此应用程序可帮助教师在线填写和分析出勤。下载JSP中提供的完整源代码。

2020-04-11

111
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大小: 1463KB

开发平台: windows

java

Java在线全球邮件系统

此项目是Java在线全球邮件系统。项目描述：E Web Mail System项目是为Btech学生的最后一年开发的，并使用Java编程语言进行了编码。 Java提供了设计基于Web的应用程序的绝佳选择，该邮件系统提供了简单而动态的Web邮件选项，例如使用SMTP，IMAP协议服务器发送文本邮件，媒体文件。 Java邮件Web服务器和Mozilla Web浏览器。

2020-04-11

51
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大小: 289KB

开发平台: windows

java

面部检测系统

此项目是面部检测系统。用于面部检测系统是一个Java项目。该软件应用程序用于根据眼睛，嘴唇，鼻子和头发等的图像切片来识别面孔。 该项目报告涵盖系统分析，可行性报告，硬件和软件要求，系统设计，样本编码和测试技术。在现有系统中，信息以文件格式存储，其中包含过时的图像和低质量的图像。 利用这些信息，因此需要开发一种更好的方法来识别指纹，DNA……等。 在所有这些方法中，人脸检测方法具有成本效益且更准确。

2020-04-11

32
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大小: 3124KB

开发平台: windows

java

Java中的网络负载平衡项目

此项目是Java中的网络负载平衡项目。Network Load Balancing系统项目是针对有兴趣开发基于Java的与网络相关的项目的计算机科学专业的大学生的Java项目。您可以下载带有Java完整源代码的Network Load Balancing项目。

2020-04-11

67
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大小: 1398KB

开发平台: windows

java

JSP中的在线生产管理系统

此项目是JSP中的在线生产管理系统。在线生产管理系统是用于管理生产任务的在线Web应用程序。该应用程序对于正在获取产品订单然后下达特定订单的公司非常有用。使用此应用程序，他们可以管理生产所需或使用的物料， 材料成本，人工成本。此应用程序对于使他们的日常任务在JSP | Java中自动化非常有用。

2020-04-10

90
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大小: 387KB

开发平台: windows

java

Node Js中的聊天应用程序

此项目是Node Js中的聊天应用程序。下载用服务器端Javascript NodeJs和Express编写的完整项目源代码。此应用程序演示在nodeJs和Express中进行套接字编程的良好示例。下载包含完整源代码的完整项目并免费提供报告。

2020-04-10

47
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大小: 4573KB

开发平台: windows

java

Asp.Net中的文档管理系统

此项目是Asp.Net中的文档管理系统。数字文档的增长非常迅速。要有效地管理和存储这些文档，需要一些管理系统。数字文档管理系统提供了组织和管理数字文档的体系结构方法。 该项目遵循使用HTML和CSS设计的面向对象设计和良好用户界面。

2020-04-10

62
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大小: 1184KB

开发平台: windows

java

Asp.Net开发的在线电子博客平台

此项目是Asp.Net开发的在线电子博客平台。博客是内容管理系统之一，每个人都可以创建自己的博客。成功注册后可以创建此博客。注册用户可以编辑或更新博客或编写更多博客。任何匿名用户都可以阅读博客 未经注册。在asp.net中下载完整的项目源代码，其中MS Sql作为数据库，C＃.Net作为编程语言。

2020-04-10

90
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大小: 377KB

开发平台: windows

java

Java人脸识别系统

此项目是Java人脸识别系统。为了识别任何人，我们需要一些由目击者提供的关于人的识别。 在大多数情况下，记录的图像片段的质量和分辨率很差，并且难以识别人脸。  可以通过多种方式完成识别，例如指纹，眼睛，DNA等。应用之一是面部识别。 面部表情是我们在社交活动中关注的主要焦点，在传达身份和情感方面起着重要作用。 该项目旨在使用先前拍摄的图像来识别人。 识别将根据不同人的先前图像进行。

2020-04-10

68
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大小: 3124KB

开发平台: windows

java

JSP中在线药房管理

此项目是JSP中在线药房管理项目。下载具有JSP，Java完整源代码的项目，并以Oracle 10g作为数据库。该项目是为希望管理常规操作的药房开发的。药房管理系统是在Java Server Pages中以netbeans作为IDE开发的。 它具有使用HTML和CSS的良好GUI。在JSP中下载带有源代码和报告的完整项目。

2020-04-09

66
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大小: 4849KB

开发平台: windows

java

在JAVA中下载网站复印机项目

Website Copier是一个用于下载完整网站以供脱机浏览的应用程序，类似于HTTRACK。完整的源代码是用Java编写的，带有完整的源代码和报告。作者使用Java.Net软件包编写了出色的Java代码。

2020-04-09

31
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大小: 228KB

开发平台: windows

java

指纹传感器生物识别门锁

此项目是基于IoT的指纹传感器生物识别门锁。在这里，我们使用GT5111C3指纹传感器，NodeMCU和电磁锁构建基于IoT的生物特征安全系统。指纹扫描仪传感器已在许多地方使用，例如工业，办公室，学校，学院和酒店。 通过将IoT与指纹传感器一起嵌入，我们可以将基于指纹的安全系统项目提升到一个新的水平。

2020-04-09

82
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大小: 1081KB

开发平台: windows

指纹识别

[FPGA教程] Basys 3 FPGA上的七段LED显示

此项目是[FPGA教程] Basys 3 FPGA上的七段LED显示。该FPGA教程将指导您如何控制Basys 3 FPGA板上的4位七段显示器。 将在Verilog中设计一个显示控制器，以在Basys 3 FPGA的4位7段LED显示屏上显示数字。 还将提供七段式LED显示控制器的完整Verilog代码。了解的更多请下载附件。

2020-04-08

154
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大小: 769KB

开发平台: Quartus

FPGA

密码协处理器设计

此项目是VHDL中的密码协处理器设计。在此VHDL项目中，在VHDL中设计和实现了用于密码应用程序的完整协处理器。如先前的Verilog / VHDL项目中所述，协处理器提供了针对安全性的标准指令和专用功能单元。 协处理器是在VHDL中设计和实现的，而ALU单元中的N位加法器是在Verilog中实现的。了解更多请下载附件。

2020-04-08

57
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大小: 142KB

开发平台: Quartus

FPGA

非线性查找表

此项目是VHDL中的非线性查找表。在该VHDL项目中，在VHDL中实现了非线性查找表，该表用于即将来临协处理器的哈希函数中。哈希算法中使用的非线性运算利用并行的4位非线性运算，其中输入半字节（4位）被映射到另一个非线性4位值。了解更多请下载附件。

2020-04-08

157
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大小: 58KB

开发平台: Quartus

FPGA

VHDL中的移位器设计

此项目是VHDL中的移位器设计。在此VHDL项目中，将在VHDL中实现一个具有移位和旋转数据能力的移位器，该移位器主要用于密码的置换和转置。 VHDL移位器是即将到来的协处理器处理单元中的关键组件。 快速移位和旋转功能对于密码应用至关重要。了解更多请下载附件。

2020-04-08

246
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大小: 49KB

开发平台: Quartus

FPGA

VHDL中的16位ALU设计

此项目是VHDL中的16位ALU设计。今天将介绍16位ALU设计的一部分；16位ALU是我在上个项目中介绍的协处理器中处理单元的核心组合组件。此VHDL项目中将提供16位ALU的完整VHDL代码以及测试平台（附件文件中）。了解更多请下载附件。

2020-04-08

118
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大小: 40KB

开发平台: Quartus

FPGA

Verilog中的N位加法器设计

此项目是Verilog中的N位加法器设计。下一个Verilog / VHDL项目是专门为密码应用程序设计的完整协处理器。 协处理器具有标准指令和专用于安全性的专用功能单元。 协处理器主要在VHDL中实现，但N位加法器在Verilog中设计。这个项目介绍了为协处理器设计的N位加法器的Verilog代码。 N位加法器的Verilog代码是通过使用结构建模来完成的。了解更多请下载附件。

2020-04-08

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大小: 51KB

开发平台: Quartus

FPGA

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